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许多应用程序拥有更为复杂的读取模式（几乎是随机地，特别是当cachehit不可预测的时候），并且没有有效地利用带宽。典型的这类应用程序就是业务处理软件，即使拥有如乱序执行（outoforderexecution）这样的CPU特性，也会受内存延迟的限制。这样CPU必须得等到运算所需数据被除数装载完成才能执行指令（无论这些数据来自CPUcache还是主内存系统）。当前低段系统的内存延迟大约是120－150ns，而CPU速度则达到了3GHz以上，一次单独的内存请求可能会浪费200－300次CPU循环。即使在缓存命中率（cachehitrate）达到99％的情况下，CPU也可能会花50％的时间来等待内存请求的结束－比如因为内存延迟的缘故。 你可以看到Opteron整合的内存控制器，它的延迟，与芯片组支持双通道DDR内存控制器的延迟相比来说，是要低很多的。英特尔也按照计划的那样在处理器内部整合内存控制器，这样导致北桥芯片将变得不那么重要。但改变了处理器访问主存的方式，有助于提高带宽、降低内存和提升处理器性 制造工艺：现在CPU的制造工艺是45纳米，今年1月10号上市最新的I5I可以达到32纳米，在将来的CPU制造工艺可以达到24纳米。